将FPGA技术与mcu相结合单芯片解决方案.docx
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1、将FPGA技术与mcu相结合单芯片解决方案嵌式设计人员花费大量时间为手头的任务寻找合适的微控!避(MCU)O通常,空间是一种约束,原始性能、I/O、内存资源、功耗和外围设备的正确组合成为寻找合适的圣杯。如果您具有特定设计所需的特殊逻辑,则搜索会变得更加复杂。也许这是一种“秘方”,您的公司比任何人都知道如何做得更好,并使最终产品脱颖而出。在这种情况下,很可能没有人按照您想要的方式制造MCU0还有另一种选择:协同MCU和FPGA配对。高度密集的FPGA可以吸收如此多的逻辑,以至于它们可以与微控1避甚至内部微控制器结合,从而比单独使用任何一个部分做得更多。此外,您的逻辑的专有本质隐藏在FPGA内部,
2、不会被窥探。本文讨论了允许设计人员将FPGA技术与嵌入式处理器相结合的几个选项。我们将研究单片方法、片上系统(SOC)解决方案、堆叠和模块。单甚庄解决方案可以使Micros运行得非常快。我们都熟悉触手可及的数千兆赫处理避。然而,更快的处理器通常成本更高且更难实现。PCB走线变成了传输线,需要严格的阻抗控制,尤其是在关键路径信号上。并非每个设计都能承担使用此类设备进行开发的成本和时间。这使得以较低速度运行的成本更低、更通用的处理器成为我们设计的替代、更经济的选择。对于要求不高的应用,仅此一项就很好,但是当对速度的需求超过了微型的周期时间时,我们就不得不做出选择。基于软件的方法无法与功能的硬逻辑实
3、现的速度竞争。您可以在板上使用离散逻辑,或将处理器内核与纯逻辑资源(如FPGA)耦合。虽然使用更简单、不太复杂的处理器可以相当容易地设置、控制和监视实时控制和状态机设计,但有时需要更高端的外围设备、更宽的数据路径、更高的安全性和更快的执行速度需要。这种级别的处理器马力的一个很好的例子是MicroSemiSmartFUSiOn2系列部件,例如M2S050T-FGG896,它实际上是基于SoC的,将硬核IP块和FPGA结合在一个芯片上。通过利用器件内的硬核IP,理顺可以在最小的硅片空间内最大限度地利用许多系统共有的功能资源,同时为使用FPGA结构和固件的设计定制提供充分的灵活性。166MHzARM
4、Cortexw-M3处理器内核与许多高端外设(如CAN以太网、PCIExpress、SERDES和DDR功能)相结合,同时耦合到基于ACteI闪荐的50-Kgate逻辑模块(图TFo图1:166MHzARM内核提供了一个具有良好性能的通用平台。在与嵌入式50-KgateFPGA逻辑架构交互时,它可以跟上更高速度和更高要求的任务。逻辑结构为内核提供硬算术块以及可定制的外设功能和RAM资源。ARM低功耗内核与Acte1的F1ashFreeze实时电源管理系统相结合,可实现1mW的待机功率额定值,而在所有50K四输入基于查找表的逻辑时仍可达到令人印象深刻的10mW功耗元素通电。SmartFusion
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