数字逻辑课程设计报告--数字式竞赛抢答器.docx

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1、数字逻辑课程设计O论文题目：数字式竞赛抢答器一.设计题目数字式竞赛抢答内容与要求：设计制作一个可容纳八组参赛的数字式抢答器，每组抢答按钮供抢答时使用，且电路具有第一抢答信号的鉴别和锁存功能。在主持人将系统复位并发出抢答指令后，若参赛者按抢答开关，则该组指示灯亮并用组别显示电路显示出抢答者的组别，同时电路应具有自锁功能，使别的抢答开关不起作用。还要设置计分（含加分与扣分）电路。对提前抢答和超时抢答的组别鸣喇叭示警,并由组别电路显示出犯规组别。二.设计方式和要求1在电脑上应用虚拟电子工作台（EWB）进行设计，调试，仿真;2要求有课题综述，电路设计框，逻辑电路计算图，可在EWB模拟运行通过；3每人独

2、立完成课程设计。4每个人都要进行电脑演示课程设计答辩，时间约为510分钟；5答辩后课程设计报告。三.所用器件4516（二进制向上向下计算器）8个76116（锁存器）1个74148（8-3优先编码器）1个74138（3-8译码器）1个显示译码器，开关，电源若干，逻辑门若干，方波发生器，蜂鸣器等四.抢答器方框图五.器件功能及电路分析174148（8-3优先编码器）分析：当第7个管脚为。时第6个时为1,5为2,4为3,2为5,1为6,。为7,全为1时为8（又由于8二进制应为1000,与A3=GS,并且第7个管脚作用）01234567A2A1AOGSXXXXXXX00000XXXXXX010010XX

3、XXX0110100XXXX01110110XXX011111000XX0111111010X01111111100011111111110111111111111输入输出74148结论：实现8个开关转换成2进制数，电路图如下:276116（锁存器）输入输出CR1ea+IebDOD1D2D3QOQiQ2Q30XXXXX0000清O10dd1d2d3dd1d2d3迭数11XXXX保持分析：1EA+1EB有1个为1即为1故接74148的GS（开始GS为1第1个信号为0,故加非门，使原来为。后工作时为1,达到锁存输j输出CBAY()Y1Y2Y3Y4Y5Y6Y70000111111100110I111

4、111010110111110111110I111110011110111101111110111101111110111111111110结论：实现锁存功能（第1组有效，第2组以及后面的组别均无效）33-8译码器16151413但11109C9门23456Wyyyyyyy整17NDAbcgggyg1p-345677413844516（2进制加减器）功能简述：当CE为。时正常工作，CE为1时不工作，与74138联立，实现加减器功能，CP为上升沿时加1（在UPDN=1时）CP为上升沿时减1（在UPDN=O时）UP/DN由加分减分控制开关决定，下面为蜂鸣器分析：当OA端有高电平时，蜂鸣器响（提前抢答时）超时时由方波信号发生器发生T=1F（F=0.2HZ）为5S的脉冲，使达到延时效果。下面为完整电路图:六.心得：本人通过学习EWB,达到熟悉并掌握操作步骤的情况下，能独立完成电路设计，分析电路，期间尝试很多挫折和失败，但我仍不放弃,认真学习尝试，终于，功夫不负有心人，终于顺利完成了，希望老师能批评指正。